工学
问答题简述TMS320C54X芯片的CPU各组成部分及其功能。
题目
问答题
简述TMS320C54X芯片的CPU各组成部分及其功能。
参考答案和解析
正确答案：
主要包括：40位算术逻辑运算单元（ALU）、40位累加器A和B、移位-16~30位的桶形移位寄存器、乘法器/加法器单元、比较和选择及存储单元、指数编码器、CPU状态和控制寄存器。
（1）40位算术逻辑运算单元：输出40位的数据送往累加器A或B，进行溢出处理、进位位和双十六位算术运算。
（2）累加器A和B：可以配制成乘法器/加法器或ALU目的寄存器。
（3）桶形移位器：为输入的数据定标、对累加器的值进行算术或逻辑移位。
（4）乘法器/加法器单元：在一个流水线状态周期内完成一次乘法累加（MAC）运算。
（5）比较、选择和存储单元：专为Viterbi算法设计的进行加法/比较/选择运算的硬件单元。
（6）指数编码器：它可以在单个周期内执行EXP指令，求得累加器中数的指数值，并以2的补码形式存放到T寄存器中。
（7）CPU状态控制寄存器：C54x有3个状态控制寄存器：状态寄存器0（ST0）、状态寄存器1（ST1）、处理器工作方式状态寄存器（PMST）。ST0和ST1中包含各种工作条件和工作方式状态；PMST中包含存储器的设置状态及其它控制信息。
（1）40位算术逻辑运算单元：输出40位的数据送往累加器A或B，进行溢出处理、进位位和双十六位算术运算。
（2）累加器A和B：可以配制成乘法器/加法器或ALU目的寄存器。
（3）桶形移位器：为输入的数据定标、对累加器的值进行算术或逻辑移位。
（4）乘法器/加法器单元：在一个流水线状态周期内完成一次乘法累加（MAC）运算。
（5）比较、选择和存储单元：专为Viterbi算法设计的进行加法/比较/选择运算的硬件单元。
（6）指数编码器：它可以在单个周期内执行EXP指令，求得累加器中数的指数值，并以2的补码形式存放到T寄存器中。
（7）CPU状态控制寄存器：C54x有3个状态控制寄存器：状态寄存器0（ST0）、状态寄存器1（ST1）、处理器工作方式状态寄存器（PMST）。ST0和ST1中包含各种工作条件和工作方式状态；PMST中包含存储器的设置状态及其它控制信息。
解析：
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