工学

问答题已知有16K×1的DRAM芯片，其引脚功能如下：地址输入A6～A0，行地址选择RAS，列地址选择CAS，数据输入端DIN，数据输出端DOUT，控制端WE。请用给定芯片构成256KB的存储器，采用奇偶校验。试问：若芯片内部采用128×128矩阵排列，求异步刷新时该存储器的刷新间隔。

题目
问答题
已知有16K×1的DRAM芯片，其引脚功能如下：地址输入A6～A0，行地址选择RAS，列地址选择CAS，数据输入端DIN，数据输出端DOUT，控制端WE。请用给定芯片构成256KB的存储器，采用奇偶校验。试问：若芯片内部采用128×128矩阵排列，求异步刷新时该存储器的刷新间隔。
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相似问题和答案

第1题：

数据选择器又称多路选择器(Multiplexer,简称MUX),它有()位地址输入、()位数据输入、1位输出。每次在地址输入的控制下,从多路输入数据中选择一路输出,其功能类似于一个单刀多掷开关,常用的数据选择器有()、()、()、()等。


参考答案：n;2n;2选1;4选1;8选1;16选1

第2题：

以下说法正确的是（）。

A.在公式中输入"=$A5+$A6"表示对A5和A6的列地址绝对引用

B.在公式中输入"=$A5+$A6"表示对A5和A6的行、列地址相对引用

C.在公式中输入"=$A5+$A6"表示对A5和A6的行、列地址绝对引用

D.在公式中输入"=$A5+$A6"表示对A5和A6的行地址绝对引用


正确答案：A

第3题：

八路数据分配器的地址输入(选择控制)端有8个。()


参考答案：错误

第4题：

DRAM芯片怎么有行地址又有列地址？


正确答案:DRAM芯片容量大、芯片小，高集成度，引脚数量少。故DRAM芯片将地址引脚分时复用，即用一组地址引脚传送两批地址。第一批地址称行地址，第二批地址称列地址。

第5题：

一个16选一的数据选择器，其地址输入（选择控制输入）端的个数是（）。

  • A、1
  • B、2
  • C、4
  • D、16

正确答案:C

第6题：

μPD424256的容量为256K×4bit，即芯片内部有256K个存储单元，每个存储单元可存储4位信息。下面关于μPD424256的叙述中，正确的是( )。

A．芯片内部有256K个存储单元，因此芯片有18个地址引脚

B．芯片的RAS和CAS选通信号主要用于DRAM的刷新

C．芯片的数据线有4根，但为减少芯片的引脚数，它们与18个地址信号中的低4位地址线是分时复用的

D．DRAM芯片中的存储单元除像μPD424256那样存储4位信息外，有的DRAM芯片中的存储单元存储1位信息，有些存储8位信息


正确答案：D

第7题：

LOCK引脚的功能是（）。

  • A、总线锁定
  • B、地址锁定
  • C、数据输入锁定
  • D、数据输出锁定

正确答案:A

第8题：

一个8选1数据选择器,其地址输入端(选择控制输入端)的个数应是( )。

A.3

B.4

C. 2

D.8


参考答案：C

第9题：

一个32路数据选择器，其地址输入（选择控制输入）端有（）。

  • A、2个
  • B、3个
  • C、4个
  • D、5个

正确答案:D

第10题：

DRAM2116（16K×1）外部引脚有（）

  • A、7条地址线，2条数据线
  • B、7条地址线，1条数据线
  • C、14条地址线，2条数据线
  • D、14条地址线，1条数据线

正确答案:A

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