公共基础
单选题用3个D触发器组成的电路如图7-69所示，触发器F0的输入端接+5V表明D0=1，那么，在第1个CP脉冲和第2个脉冲的上升沿过后Q2Q1Q0分别是（）。A 101和011B 011和111C 001和011D 000和111
题目
单选题
用3个D触发器组成的电路如图7-69所示，触发器F0的输入端接+5V表明D0=1，那么，在第1个CP脉冲和第2个脉冲的上升沿过后Q2Q1Q0分别是（）。
A
101和011
B
011和111
C
001和011
D
000和111
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相似问题和答案
第1题：
已知电路及输入信号波形如图4－13所示.试画出主从JK触发器的Q'.Q端的波形,触发器初始状态为0.
答案:波形图如图4-13所示.
第2题：
在图4-33(a)所示各电路图中,CP.A.B的波形如图4-33(b)所示.
(1)写出触发器次态Qn+1的函数表达式.
(2)画出Q1、Q2.Q3、Q4的波形图.假设各触发器初始状态均为0.
答案:
第3题：
RS触发器在CP脉冲的作用下,根据输入信号RS,可以:()
A、保持
B、置0
C、置1
D、翻转
参考答案：ABC
第4题：
逻辑电路如图所示，A=“1”时，C脉冲来到后D触发器（ ）。
A．具有计数器功能
B．置“0”
C．置“1”
D．无法确定
B．置“0”
C．置“1”
D．无法确定
答案：A
解析：
D触发器的逻辑关系式为，
第5题：
D触发器组成的电路如图a)所示。设Q1、Q2的初始态是0、0，已知CP脉冲波型，Q2的波形是图b)中哪个图形？
答案：A
解析：
提示：从时钟输入端的符号可见，该触发器为正边沿触发方式。即：当时钟信号由低电平上升为髙电平时刻，输出端的状态可能发生改变，变化的逻辑结果由触发器的逻辑表决定。
第6题：
图4-27(a),(b)分别示出了触发器和逻辑门构成的脉冲分频器电路,CP脉冲如图4-27(c)所示,各触发器的初始状态皆为0.
(1)试画出图4-27(a)的Q1、Q2和F的波形.
(2)试画出图4-27(b)的Q1、Q2和Y的波形.
答案:
第7题：
JK触发器及其输入信号波形如图所示，那么，在t=t0和t=t1时刻，输出Q分别为:
答案：B
解析：
图示电路是下降沿触发的JK触发器，及
是触发器的异步清零端，由触发器的逻辑功能分析即可得答案。
是触发器的异步清零端，由触发器的逻辑功能分析即可得答案。第8题：
对于JK触发器，输入J=0、K=1，CP脉冲作用后，触发器的应为()
A、0
B、1
C、可能是0，也可能是1
D、与有关
参考答案A
第9题：
由两个主从型JK触发器组成的逻辑电路如图a）所示，设Q1、Q2的初始态是00，已知输入信号A和脉冲信号CP的波形如图b）所示，当第二个CP脉冲作用后，Q1Q2将变为（ ）。
A．11
B．10
C．01
D．保持00不变
B．10
C．01
D．保持00不变
答案：C
解析：
根据触发器符号可见输出信号在CP脉冲的下降沿动作。根据JK触发器的特征方程
得到当第二个CP脉冲作用后，Q1Q2将变为01。
得到当第二个CP脉冲作用后，Q1Q2将变为01。
第10题：
由两个主从型JK触发器组成的逻辑电路如图a)所示，设Q1、Q2的初始态是0、0， 已知输入信号A和脉冲信号CP的波形，如图b)所示，当第二个CP脉冲作用后，Q1、Q2将变为：
A. 1、1
B. 1、0
C. 0、1
D.保持0、0不变
B. 1、0
C. 0、1
D.保持0、0不变
答案：C
解析：
提示：该触发器为负边沿触发方式，即：当时钟信号由高电平下降为低电平时刻输出端的状态可能发生改变。